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PCB科技 - 完美提高PCB板對電源變化的免疫力的幾個技巧

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PCB科技 - 完美提高PCB板對電源變化的免疫力的幾個技巧

完美提高PCB板對電源變化的免疫力的幾個技巧

2021-09-05
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Author:Beele

對於轉換器和最終系統,必須確保任何給定輸入上的雜訊都不會影響效能。 辣嗎? 為了瞭解電源雜訊並滿足系統設計要求,在PCB板上應該注意哪些方面?

首先選擇轉換器,然後選擇穩壓器、LDO、開關穩壓器等。 並非所有監管機构都適合。 您應該檢查調節器資料表中的雜訊和紋波規格,以及開關頻率(如果使用開關調節器)。 典型的穩壓器在100kHz頻寬內可能有10µVrms的雜訊。 假設雜訊是白色雜訊,則相當於目標頻帶中的雜訊密度為31.6nVrms/âHz。

檢查轉換器的電源抑制指數,以瞭解轉換器的效能何時會因電源雜訊而下降。 在第一奈奎斯特區fS/2,大多數高速轉換器的PSRR通常為60dB(1mV/V)。 如果資料表中沒有給出該值,請根據上述方法進行量測,或諮詢製造商。

使用具有2Vp-p滿量程輸入範圍、78dBSNR和125MSPS取樣速率的16比特ADC,其本底雜訊為11.26nVrms。 任何來源的雜訊都必須低於此值,以防止其影響轉換器。 在第一個奈奎斯特區,轉換器雜訊將為89.02µVrms(11.26nVrms/âHz)*â(125MHz/2)。 雖然穩壓器的雜訊(31.6nv/âHz)是轉換器的兩倍多,但轉換器的電源抑制比為60dB,這將把開關穩壓器的雜訊抑制到31.6pV/âHz(31.6nv/âHz*1mV/V)。 該噪聲遠小於轉換器的本底雜訊,囙此調節器的雜訊不會降低轉換器的效能。

電源濾波、接地和佈局同樣重要。 在ADC電源引脚上添加0.1µF電容器可以使雜訊低於上述計算值。 請記住,某些電源引脚比其他電源引脚消耗更多電流或更敏感。 囙此,應謹慎使用去耦電容器,但請注意,某些電源引脚可能需要額外的去耦電容器。 在電源的輸出端添加一個簡單的LC濾波器也有助於降低雜訊。 然而,當使用開關調節器時,級聯濾波器可以將雜訊抑制到較低的水准。 需要記住的是,每新增一級增益,每10個倍頻程將新增約20dB。

需要注意的是,上述分析僅適用於單個轉換器。 如果系統涉及多個轉換器或通道,雜訊分析將有所不同。 例如,超聲系統使用許多ADC通道,這些通道被數位求和以新增動態範圍。 基本上,每次通道數量加倍時,轉換器/系統的雜訊基底都會降低3dB。 對於上述示例,如果使用兩個轉換器,則轉換器的本底雜訊將變為一半(-3dB); 如果使用四個轉換器,雜訊基底將變為-6dB。 這是因為每個轉換器都可以被視為不相關的雜訊源。 不相關的雜訊源彼此獨立,囙此可以進行RSS(平方和的平方根)計算。 最終,隨著通道數量的新增和系統雜訊基底的降低,系統將變得更加敏感,對電源的設計約束也將變得更加嚴格。

要消除應用中的所有電源雜訊是不可能的,因為沒有一個系統可以完全不受電源雜訊的影響。 囙此,作為ADC的用戶,我們必須在電源設計和佈局階段積極回應。

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以下是一些有用的提示,可以幫助您最大限度地提高PCB對電源變化的免疫力:

斷開所有到達系統板的電源軌和匯流排電壓。

記住:每新增10倍頻程,增益將新增約20dB。

如果電源引線較長,並為特定的IC、設備和/或區域供電,則應再次斷開。

高頻和低頻都必須解耦。

去耦電容器接地前的電源入口點通常使用串聯鐵氧體磁珠。 對進入系統板的每個電源電壓都這樣做,無論是來自LDO還是開關穩壓器。

對於添加的電容器,應使用緊密堆疊的電源層和接地層(間距為4密耳),以便PCB設計本身具有高頻去耦能力。

與任何良好的電路板佈局一樣,電源應遠離敏感的類比電路,如ADC的前端級和時鐘電路。

良好的電路劃分非常重要,一些元件可以放置在PCB的背面以增强隔離。

注意接地回路,特別是在數位側,以確保數位瞬態不會返回到電路板的類比部分。 在某些情况下,單獨的接地平面也可能有用。

將類比和數位參攷組件保持在各自的水准。 這種傳統方法可以增强對雜訊和耦合相互作用的隔離。

遵循IC製造商的建議。 如果申請說明或資料表沒有直接解釋,則應研究評估委員會。 這些都是很好的入門工具。