Leiterplattentechnisch - Das Problem der Lötstellenschälung in der SMT-Chipverarbeitung

Das Problem der Lötstellenschälung in SMT chip processing

The phenomenon von Lötstellenschälung mostly occurs in the through-hole wave Lötverfahren, aber es ist auch in der SMT Reflow-Lötverfahren. Das Phänomen ist, dass es einen Fehler und ein Schälen zwischen der Lötstelle und dem Pad gibt, wie in Abbildung 1 gezeigt. Der Hauptgrund für diese Art von Phänomen ist der große Unterschied zwischen dem Wärmeausdehnungskoeffizienten bleifreier Legierungen und dem Substrat, was zu viel Spannung im geschälten Teil der Lötstellen verursacht, um sie zu trennen, Die nichteutektischen Eigenschaften einiger Lötlegierungen sind auch einer der Gründe für dieses Phänomen. Daher, Es gibt zwei Möglichkeiten, mit diesem Problem umzugehen PCB Problem. Eine ist, eine geeignete Lötlegierung zu wählen; Die andere ist, die Abkühlrate so zu steuern, dass die Lötstellen so schnell wie möglich erstarren, um eine starke Bindungskraft zu bilden. Zusätzlich zu diesen Methoden, Die Größe der Spannung kann auch durch Auslegung reduziert werden, das ist, Die Kupferringfläche des Durchgangslochs wird reduziert. Eine beliebte Praxis in Japan ist die Verwendung von SMD Pad Design, das ist, Begrenzung der Fläche des Kupferrings durch die grüne Lotmaske. Allerdings, dieser Ansatz hat zwei unerwünschte Aspekte. Eine ist, dass das leichte Schälen nicht leicht zu sehen ist; Die andere ist die Bildung von Lötstellen zwischen dem grünen Öl und der Schnittstelle des SMD-Pads, was aus der Sicht des Lebens nicht ideal ist. of.

An den Lötstellen treten einige Schälphänomene auf, called cracks or tearing (Tearing). Wenn dieses Problem an den Wellendurchgangslötstellen auftritt, Einige Zulieferer der Branche halten es für akzeptabel. Hauptsächlich weil die Schlüsselteile des Durchgangslochs nicht an dieser Stelle sind. Aber wenn es auf den Reflow-Lötstellen erscheint, es sollte als Qualitätsproblem betrachtet werden, unless the degree is very small (similar to wrinkles).

Das Vorhandensein von Bi wirkt sich sowohl auf Reflow- als auch Wellenlötprozesse aus, das ist, solder joint peeling. Aufgrund der Migrationseigenschaften von Bi-Atomen, nur während und nach dem SMT soldering process, Bi-Atome wandern an die Oberfläche und zwischen bleifreiem Lot und Kupferpad, was zu einer "abgesonderten" unerwünschten dünnen Schicht führt, das mit dem Löt und PCB während der Anwendung. Die CTE-Diskrepanz zwischen zentraler Beschaffung führt zu vertikalem Schweben und Rissen.

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