Leiterplattentechnisch - Warum benötigen Hochgeschwindigkeits-Leiterplatten gleich lange Verdrahtung?

Warum High-Speed Leiterplatten Gleichlange Verkabelung erforderlich?
Das effektive Einrichtungs- und Wartungsfenster von Hochgeschwindigkeitssignalen ist relativ klein. Um die Daten und Steuersignale innerhalb des effektiven Fensters zu halten, der Unterschied in der Spurlänge zwischen den Daten, Uhr oder Daten, und zwischen Steuersignalen ist sehr klein. Die spezifische zulässige Abweichung kann durch Berechnung der Zeitverzögerung ermittelt werden.
In der Tat, im Allgemeinen, Sequenzielle Logiksignale müssen die Rüstzeit und Haltezeit erfüllen und einen gewissen Spielraum haben. Solange diese Bedingung erfüllt ist, das Signal darf nicht unbedingt gleich lang sein. Allerdings, the actual situation is that for high-speed signals (such as DDR2, DDR3, FSB), it is impossible to know whether the timing meets the setup time and hold time requirements during the design (there are too many influencing factors, including the internal wiring and capacitance of the chip). Der durch die Last verursachte Verzögerungsunterschied muss berücksichtigt werden, it is difficult to estimate the actual value through calculation), a controllable delay device must be set inside the chip (the delay is controlled by the register), und dann wird der Wert des Registers gescannt, um verschiedene Verzögerungen auszuprobieren. And by observing the signal (look at the waveform directly, and measure the setup and hold time) to determine the delay value to meet the setup time and hold time requirements. Allerdings, Der gleiche Signaltyp wird in der Regel nur für eine oder einige der Signalleitungen beobachtet. Damit alle Signale den zeitlichen Anforderungen entsprechen, Es muss angegeben werden, dass die gleiche Art von Signalleitungen alle streng gleich lang sind.

Das obige ist ein paralleles Hochgeschwindigkeitssignal. Für serielle Hochgeschwindigkeitssignale, wenn sie getaktet sind, Die Takt- und Seriendaten müssen auch die Einrichtungs- und Haltezeitanforderungen erfüllen, so muss auch die Länge kontrolliert werden.
Obwohl einige serielle Hochgeschwindigkeitssignale eine Uhr haben, Diese Uhr wird nicht verwendet, um Daten zu sperren, sondern eine Referenzuhr mit einer niedrigeren Frequenz. Dann kann die Schiefe von Daten und Takt und Daten zwischen mehreren Kanälen viel lockerer sein, und es gibt keine Notwendigkeit, streng zu warten. Lang, weil der Empfangschip das Startbit jedes Kanals korrekt finden und die PLL-Frequenzmultiplikation und Phasenverschiebung verwenden kann, um die Daten zu sperren. Zum Beispiel, für TMDS-Signale, Die Differentialpaare der seriellen Daten müssen in der Länge streng gleich sein, aber die Schiefe zwischen den Daten ist entspannt auf ++/-20% des Taktzyklus. Allerdings, um unnötige Probleme zu vermeiden, allgemein gesprochen, serielle Signale wie TMDS und PCI-E müssen die gleiche Länge zwischen den Kanälen haben, aber die zulässige Abweichung kann relativ groß sein, wie 200ps oder mehr.

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