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回路図の共通ミス <エー href="エー_href_0" target="_blank">PCBダイアグラム
回路図における共通誤差
( 1 ) ERCレポートピンに接続されていないシグナルはありません。
パッケージが作成されるとき、I / O属性はピンのために定義されます;
コンポーネントが作成されるか、置かれるとき、一貫性のない格子属性は修正されます、そして、ピンとワイヤーは接続されません;
c .コンポーネントを作成するときは、ピンの方向を反転し、非ピン名の終了を接続する必要があります。
（2）部品は図面境界から出てきた。コンポーネントライブラリのダイアグラム用紙の中央に部品は作られなかった。
( 3 )作成されたプロジェクトファイルのネットリストは部分的にPCBにインポートすることができます。ネットリストが生成されると、グローバルは選択されません。
( 4 )自分で作成したコンポーネントを使用する場合は、注釈を使用しないでください。
PCBにおける共通エラー
（1）ネットワークをロードする際にノードが見つからないことを報告した。
a. 図のコンポーネントは、 PCBライブラリ;
B .図の構成要素は、PCBライブラリ内で矛盾する名前を持つパッケージを使用します
C .図の構成要素は、PCBライブラリ内の矛盾するピン番号を持つパッケージを使用します。例えば、3極：SCHのピン番号はE、B、C、PCBでは1、2、3である。
（2）印刷時に常に1ページに印刷できない。
A . PCBライブラリを作成する際の原点にはありません。
b .コンポーネントは、何度も動かされて、回転しました、そして、PCBボード境界の外に隠れた性格があります。を選択し、すべての隠し文字を表示するには、PCBを縮小し、境界に文字を移動します。プラグイン、ウイルスがない
（3）DRC報告ネットワークはいくつかの部分に分けられる。
このネットワークが接続されていないことを示します。レポートファイルを見て、それを見つけるために接続された銅を使用してください。
さらに、できるだけ多くのブルースクリーンのチャンスを減らすためにWin 2000を使用して友達を思い出させるファイルのサイズとprotelの凍結のチャンスを減らすために新しいDDBファイルを作るために何度かファイルをエクスポートします。より複雑な設計をするなら、自動ルーティングを使わないようにしてください。
PCB設計において、配線は製品設計を完了する重要なステップである。それは前の準備をすると言うことができます。PCB全体では、配線設計プロセスは、最高限度、最高の技術と最大の仕事量を持ちます。PCB配線は、片面配線、両面配線および多層配線を含む。配線と配線の2つの方法もある。自動配線する前に、事前に配線を使用することができますし、より厳しい行を要求します。入力端と出力端のエッジは、反射干渉を避けるために隣接して並列に回避されるべきである。必要に応じて、接地用の配線を分離する必要があり、隣接する2層の配線を互いに直交させる必要がある。寄生結合は並列に起こり易い。
自動ルーティングのルーティングレートは良いレイアウトに依存します。ルーティングルールは、曲げ時間の数、バイアの数、およびステップ数を含むプリセットすることができます。一般的に、最初にワープ配線を探索し、すぐに短いワイヤーを接続し、次に迷路の配線を実行します。まず、グローバル配線経路に対して配線すべき配線を最適化する。必要に応じて配線を切断することができます。また、全体的な効果を改善するために再配線してください。
現在の高密度 PCB設計 スルーホールが適切でないと感じた. それは、多くの貴重な配線チャンネルを浪費します. この矛盾を解決するために, ブラインドおよび埋め込みホール技術が出現した, スルーホールの役割を果たすだけでなく. また、配線プロセスをより便利にするために多くの配線チャネルを節約, より滑らかでより完全な. The PCB設計 プロセスは複雑で簡単なプロセスである. あなたがそれをマスターしたいなら, あなたが行くには電子工学デザイナーの数が必要です. あなたがそれを経験するときだけ、あなたはそれの本当の意味を得ることができますか.
