Pembuatan PCB Ketepatan, PCB Frekuensi Tinggi, PCB Berkelajuan Tinggi, PCB Berbilang Lapisan dan Pemasangan PCB.
Kilang perkhidmatan tersuai PCB & PCBA yang paling boleh dipercayai.
Berita PCB

Berita PCB - Via papan sirkuit PCB mempengaruhi penghantaran isyarat

Berita PCB

Berita PCB - Via papan sirkuit PCB mempengaruhi penghantaran isyarat

Via papan sirkuit PCB mempengaruhi penghantaran isyarat

2021-10-23
View:421
Author:Aure

Via papan sirkuit PCB mempengaruhi penghantaran isyarat


Via adalah salah satu komponen penting papan sirkuit PCB berbilang lapisan, dan biaya pengeboran biasanya mengandungi 30% hingga 40% biaya penghasilan PCB. Hanya saja, setiap lubang di PCB boleh dipanggil melalui.

Satu, kapasitas parasit dari vias

Melalui diri sendiri mempunyai kapasitas parasit ke tanah. Jika diketahui bahawa diameter lubang izolasi pada lapisan tanah melalui adalah D2, diameter pad melalui adalah D1, tebal papan PCB adalah T, dan konstan dielektrik substrat papan adalah ε, Saiz kapasitas parasit melalui sekitar: C=1.41εTD1/(D2-D1) Kapsitas parasit melalui akan menyebabkan sirkuit untuk memperpanjang masa naik isyarat dan mengurangkan kelajuan sirkuit. Contohnya, untuk PCB dengan tebal 50Mil, jika melalui dengan diameter dalaman 10Mil dan diameter pad 20Mil digunakan, dan jarak antara pad dan kawasan tembaga tanah ialah 32Mil, maka kita boleh kira-kira melalui menggunakan formula di atas Kapensiti parasit adalah kira-kira: C=1.41x4.4x0.050x0.020/(0.032-0.020)=0.517pF, - perubahan masa naik disebabkan oleh bahagian ini kapasitas adalah: T10-90=2.2C(Z0/2)=2.2 x0.517x(55/2)=31.28ps. Ia boleh dilihat dari nilai-nilai ini bahawa walaupun kesan lambat naik disebabkan oleh kapasitas parasit tunggal melalui tidak jelas, jika melalui digunakan berbilang kali dalam jejak untuk menukar antara lapisan, perancang patut mempertimbangkan dengan hati-hati.



Papan sirkuit PCB



2. Induktan parasit vias

Sama seperti, terdapat induksi parasit bersama dengan kapasitas parasit vias. Dalam rancangan sirkuit digital kelajuan tinggi, induktan parasit vias sering menyebabkan kerosakan lebih daripada kapasitasi parasit. Induktansi seri parasitik akan lemahkan kontribusi kondensator bypass dan lemahkan kesan penapisan seluruh sistem kuasa. Kita hanya boleh kira induktan parasit kira-kira melalui dengan formula berikut: L=5.08h[ln(4h/d)+1] di mana L merujuk kepada induktan melalui, h ialah panjang melalui, dan d ialah tengah diameter lubang. Ia boleh dilihat dari formula bahawa diameter melalui mempunyai pengaruh kecil pada induktan, dan panjang melalui mempunyai pengaruh terbesar pada induktan. Masih menggunakan contoh di atas, induktansi laluan boleh dihitung sebagai: L=5.08x0.050[ln(4x0.050/0.010)+1]=1.015nH. Jika masa naik isyarat adalah 1ns, maka impedance yang sama adalah: XL=Ï-L/T10-90=3.19Ω. Impedansi seperti ini tidak boleh lagi diabaikan apabila arus frekuensi tinggi berlalu. Perhatian istimewa perlu diberikan kepada fakta bahawa kapasitator bypass perlu melewati dua vias apabila menyambung pesawat kuasa dan pesawat tanah, sehingga induktan parasit vias akan meningkat secara eksponensial.

3. Melalui desain dalam PCB kelajuan tinggi

Melalui analisis atas ciri-ciri parasit vias, kita boleh melihat bahawa dalam rekaan PCB kelajuan tinggi, kelihatannya vias sederhana sering membawa kesan negatif besar kepada rekaan sirkuit. Untuk mengurangi kesan negatif yang disebabkan oleh kesan parasit vias, perkara berikut boleh dilakukan dalam rancangan:

1. Dari dua aspek kualiti kos dan isyarat, pilih saiz yang masuk akal melalui. Contohnya, untuk rancangan modul memori PCB 6-10 lapisan, lebih baik menggunakan kunci 10/20Mil (drilled/pad). Untuk beberapa papan besar-densiti saiz kecil, anda juga boleh cuba menggunakan 8/18Mil. lubang. Dalam keadaan teknikal semasa, ia sukar untuk menggunakan vias yang lebih kecil. Untuk kuasa atau butang tanah, anda boleh mempertimbangkan menggunakan saiz yang lebih besar untuk mengurangkan impedance.

2. Dua formula yang dibincangkan di atas boleh dikatakan bahawa penggunaan PCB yang lebih tipis adalah bermanfaat untuk mengurangi dua parameter parasit melalui.

3. Kekuatan dan pins tanah seharusnya didorong dekat, dan memimpin antara melalui dan pin seharusnya sebagai pendek yang mungkin, kerana mereka akan meningkatkan induktan. Pada masa yang sama, kuasa dan tanah memimpin seharusnya sebisak mungkin untuk mengurangi impedance.

4. Cuba untuk tidak mengubah lapisan jejak isyarat pada papan PCB, iaitu, cuba untuk tidak menggunakan kunci yang tidak diperlukan.

5. Letakkan beberapa kunci mendarat dekat kunci pengubah lapisan isyarat untuk menyediakan gelung terdekat untuk isyarat. Ia bahkan mungkin untuk meletakkan sejumlah besar vial tanah yang berlebihan di papan PCB. Tentu saja, rancangan perlu fleksibel. Model yang dibincangkan lebih awal adalah kes di mana ada pads pada setiap lapisan. Kadang-kadang, kita boleh mengurangi atau bahkan membuang pads beberapa lapisan. Terutama apabila ketepatan botol sangat tinggi, ia mungkin menyebabkan bentuk tumpuan pecah yang memisahkan loop dalam lapisan tembaga. Untuk menyelesaikan masalah ini, selain bergerak kedudukan melalui, kita juga boleh pertimbangkan meletakkan melalui pada lapisan tembaga. Saiz pad dikurangkan.